[Stage] Analyse innovante des performances HPC
❓ Qui sommes-nous ?
Fondée en 2019 avec le soutien de l'Union européenne 🇪🇺, SiPearl incarne le rêve de l'Europe de maîtriser le cœur technologique de ses supercalculateurs : le microprocesseur.
SiPearl développe Rhea, le microprocesseur européen hautes performances et basse consommation dédié au supercalcul et IA.
Cette nouvelle génération de microprocesseurs ciblera en premier lieu l’écosystème EuroHPC, qui déploie en Europe des infrastructures de calcul intensif de classe mondiale pour résoudre les défis majeurs de la recherche médicale, de l’intelligence artificielle, de la sécurité, de la gestion de l’énergie et du climat avec une empreinte carbone réduite.
SiPearl travaille en étroite collaboration avec ses 30 partenaires du consortium European Processor Initiative (EPI) - grands noms de la communauté scientifique, des centres de calcul intensif et de l'industrie - qui sont ses parties prenantes, futurs clients et utilisateurs finaux.
SiPearl emploie plus de 190 personnes dans :
- France (Maisons-Laffitte, Grenoble, Massy, Sophia Antipolis),
- Allemagne (Duisbourg)
- Espagne (Barcelone)
- et l'Italie (Bologne)
SiPearl fait partie de la promotion 2024 du programme French Tech Next 120.
🎯 À propos du stage :
Dans ce rôle, vous travaillerez en étroite collaboration avec Olivier Deprez, notre chef d'équipe de l'architecture des systèmes et des logiciels.
Les processeurs HPC récents basés sur l'architecture ARM reposent sur un réseau maillé cohérent (CMN) pour assurer la communication entre les cœurs, la mémoire et les autres unités (stockage, PCIe,...). Ce réseau maillé est le principal lien physique entre ces unités, transportant les données avec une large bande passante. Au-dessus du CMN, une couche de transport appelée CHI est utilisée pour transmettre des flots de données d'un point à l'autre. Le CMN est un élément essentiel lorsqu'il s'agit d'évaluer les performances dans un contexte HPC.
L'analyse des performances est un sujet important dans le domaine du calcul intensif, car elle constitue la première étape de l'optimisation et de l'accélération d'un programme ou d'une application spécifique pour une architecture donnée. Il existe différentes méthodologies et techniques pour l'analyse des performances, et elles sont souvent basées sur un type d'unité matérielle spécialisée appelée (unité de surveillance des performances) Core PMU. Les unités de surveillance des performances surveillent les événements des cœurs de l'unité centrale elle-même. Le comptage et l'agrégation de ces événements sur plusieurs cœurs donnent un premier niveau de méthodologies d'analyse. Par exemple, la méthodologie descendante est basée sur les PMU de base. Le CMN lui-même est également équipé de différents types de PMU, mais il n'existe pas de méthodologie claire pour exploiter les PMU du CMN.
L'objectif du stage est de développer une méthodologie pour le CMN.
🔍 Ce qui vous permettra de réussir dans ce rôle :
- Bonne compréhension de l'architecture moderne des processeurs
- Bonne capacité d'apprentissage
- Bonne capacité d'écriture
- Familiarité avec l'environnement et les outils de développement Linux
- Familiarité avec les outils de développement essentiels tels que gcc, git, make, cmake
- Familiarité avec le langage C
- La maîtrise de l'anglais est une condition préalable à la réussite dans ce rôle, car une communication efficace en anglais est essentielle pour la collaboration et l'exécution sans faille des responsabilités.
➕ Des connaissances dans les domaines suivants est un plus :
- Architecture ARM
- HPC
- Benchmark
- CMN
- Optimisation des performances et du profilage
- Système ARM et pile logicielle
- Architecture CPU applicative ARM
Cher(e) candidat(e), même si vous pensez ne pas remplir toutes les conditions mentionnées ci-dessus, n'hésitez pas à postuler et à nous faire part des raisons pour lesquelles vous pensez que vous seriez un bon candidat.
Processus de recrutement
✔️ Entretien de découverte avec notre Talent Acquisition Partner (30')
✔️ Test AssessFirst - il n'y a pas de bonnes ou de mauvaises réponses ; notre objectif est de voir au-delà de votre CV (45')
✔️ 1 entretien technique (1h)
💡 Avantages et conditions de travail :
• Contrat : Stage de pré-embauche (stage de fin d'études) - 6 mois
• 📍 Site : Maisons-Laffite ou Massy-Palaiseau
• Début : À partir de janvier 2025
• Avantages : tickets-restaurants (60% pris en charge par SiPearl), 3 jours de congés payés
• Activités telles que : Hackathons, Défis de formation, All hands sessions, événements d'équipe, événements d'entreprise et bien plus encore
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Chez SiPearl, nous nous engageons à construire un lieu de travail diversifié et inclusif qui prospère grâce à la force de perspectives et d'origines variées. Nous recrutons des talents en fonction du mérite, de l'expérience et de l'alignement avec les objectifs et les valeurs de notre entreprise.
- Department
- Software
- Role
- Architecture
- Locations
- Massy , Maisons-Laffitte
- Remote status
- Hybrid
About SiPearl
Founded in 2019 with the support of the European Union, SiPearl embodies Europe's dream of mastering the technological heart of its supercomputers: the microprocessor.
SiPearl is building Rhea, the high-performance, low-power European microprocessor dedicated to supercomputing and AI inference.
This new generation of microprocessors will first target EuroHPC Joint Undertaking ecosystem, which is deploying world-class supercomputing infrastructures in Europe for solving major challenges in medical research, artificial intelligence, security, energy management and climate with a reduced carbon footprint.
SiPearl is working in close collaboration with its 30 partners from the European Processor Initiative (EPI) consortium - leading names from the scientific community, supercomputing centers and industry - which are its stakeholders, future clients and end-users.
SiPearl employs more than 200 people in:
- France (Maisons-Laffitte, Grenoble, Massy, Sophia Antipolis),
- Germany (Duisburg)
- Spain (Barcelona)
- and Italy (Bologna)
SiPearl is part of French Tech 120 program 2024 class.
[Stage] Analyse innovante des performances HPC
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